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時間10:30〜11:15   ■TeraForm設計フロー応用例 LSIロジック社における実例及び「RapidChip用RTL解析ツール“RapidPRO

日本テラ・システムズ(株)
今村 聡子 氏 (ASIC/RapidChipビジネスディビジョン シニアフィールドアプリケーションエンジニア/LSIロジック(株))

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  時間10:30〜11:15 ■米Auspy社の最新FPGAパーティショニングソフトウェアAPSU4.0による数百万ゲート以上の規模のプロトタイピング

プロトタイピング・ジャパン(株)
鳥本元彦 氏 (社長兼CEO)

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■Linking Chip Design To Manufacturing

Silicon Integration Initiative
Don Cottrell 氏 (Si2 Fellow -- Emerging Technologies)

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  時間10:30〜11:15   ■『C言語ベース設計』をすぐ実践できるXModelink-SystemC Debugger

キャッツ(株)
浅利 康二 氏

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  時間10:30〜11:15  
時間11:30〜12:15 ■ミックズドシグナル・ソリューションDiscoveryAMSならびにポストレイアウト検証フロー

日本シノプシス(株)
海老原 隆 氏 (技術本部 シニア アプリケーション コンサルタント)

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■TeraFormがサポートするNECエレクトロニクス社製最先端Structured ASIC"ISSP90"の紹介

日本テラ・システムズ(株)
佐藤 文彦 氏 (第一開発事業本部 / 第三カスタムSLI事業部シニアマーケティングプロフェッショナル/NECエレクトロニクス(株))

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■ソフトジン社のEDAソフトウェア開発サービスのご紹介

SoftJin Infotec Private Ltd
Nachiket Urdhawareshe 氏 (最高経営責任者(CEO))

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時間11:30〜12:15 ■スウェーデンHARDI社による超高速・高信頼性の最先端ASICプロトタイピングシステムのご紹介

プロトタイピング・ジャパン(株)
Lars-Eric Lundgren 氏 (社長兼CEO/スウェーデンHARDI社)

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■Linking Chip Design To Manufacturing

Silicon Integration Initiative
Don Cottrell 氏 (Si2 Fellow -- Emerging Technologies)

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■Hybrid verfication of Timing and Power

(株)エイキャド コーポレーション
Andy Huang 氏 (CEO/ACAD Corporation)

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時間11:30〜12:15   ■<スキャン診断におけるLSI内部信号計測>(時間分解型顕微鏡を用いた解析の時間短縮)

イノテック(株)
Steven Kasapy 氏 (Director of Technical Marketing/Credence Systems Corporation)

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■普及期を迎えたSystemCベースの設計メソドロジーに必要となる現実的なツールのご提案

サミット・デザイン・ジャパン(株)
牧野 潔 氏 (代表取締役)

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時間11:30〜12:15 ■ケイデンスのCTOによるR&D戦略と最新開発事例

日本ケイデンス・デザイン・システムズ社
Aki Fujimura 氏 (Chief Technology Officer, New Business Incubation/米国ケイデンス・デザイン・システムズ社)

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時間12:30〜13:15 ■ひと味ちがうストラクチャードASIC! アルテラ社の HardCopyファミリ

日本アルテラ(株)
堀内 伸郎 氏 (マーケティング部 プロダクトマーケティング マネージャー)

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■クロック系&電源系設計のプログラマブル・ソリューション

ラティスセミコンダクター(株)
Jock Tomlinson 氏 (Vice President of Applications / Lattice Semiconductor Corporation)

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■Syntest Technology社 Virtual SCANによるテストコストリダクションツールによるDFTソリューション

丸紅ソリューション(株)
NECマイクロシステム(株)


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時間12:30〜13:15 ■VHS(ベリフィケーション・ホットスポット)によるSoC高品質検証 *株式会社富士通様実例発表*

ゼロインデザインオートメーション(株)
朽木 順一 氏 (デザインベリフィケーションコンサルタント)

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■Linking Chip Design To Manufacturing

Silicon Integration Initiative
Don Cottrell 氏 (Si2 Fellow -- Emerging Technologies)

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■EDA新会社設立のご紹介

セイコーインスツルメンツ(株)/(株)ジーダット


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時間12:30〜13:15   ■アダプティブ・コンピューティング・マシーン(ACM)の概要

富士通デバイス(株)
大倉 淳 氏 (技術本部長/クイックシルバー・テクノロジー・ジャパン(株))

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■ケイデンスのICデジタル設計ソリューションEncounter Platform

日本ケイデンス・デザイン・システムズ社
田中 厚 氏 (プロダクト・マーケティング ディレクター)

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時間12:30〜13:15  
時間13:30〜14:15 ■回路シミュレータHSPICEの最新機能

NTTアドバンステクノロジ(株) 西海 栄一 氏 (CADシステム事業部 回路設計技術部 主任)

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■アナログ設計を根本から変えるバルセロナ社の回路合成技術

(株)ソリトンシステムズ

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■Super-FinSim Verilog Simulatorの最新機能

(株)アプリスター
Alec Stanclescue 氏 (President/Fintronic USA, Inc.)

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時間13:30〜14:15 ■EDA環境向け サンの最新プラットフォーム戦略

伊藤忠テクノサイエンス(株)
当日発表 (当日発表/サン・マイクロシステムズ(株))

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■アナログ/ミックスド・シグナルに対するシルバコの取り組みとソリューション

(株)シルバコ・ジャパン
Dr. Ivan Pesic 氏 (社長兼CEO)

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■「PCI Expressデザイン・インタフェースの設計&検証手法」

デナリソフトウエア(株)
小林 亘 氏 (技術部 技術マネージャ)

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時間13:30〜14:15 ■普及段階に入るCMOSマルチギガビット高速インタフェース

富士通(株)
兼頭 武 氏 (ネットワーク開発部 部長/富士通LSIソリューション(株))

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■Sonics社の提供する1000万ゲート時代のSoC開発ソリューション

イノテック(株)
鈴木 一可 氏 (デザインシステム部 主任技師)

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■Cadence Incisive Verification Platformのロードマップ

日本ケイデンス・デザイン・システムズ社
後藤 謙治 氏 (プロダクト・マーケティング シニア マネージャ)

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時間13:30〜14:15  
時間14:30〜15:15 ■ナノメーター設計対応の高速・高精度フィジカル抽出/検証ソリューション

日本シノプシス(株)
妻藤 一雄 氏 (技術本部 アプリケーション コンサルタント)

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■アサーション記述をハードウェアに実装可能な Aldec社のHWアクセラレーション環境

(株)ソリトンシステムズ
伊達 啓次郎 氏 (HDLグループ)

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■テーマ:アナログ、ミックスド・シグナル、高度デジタル・ポイント・ツール対応の、短期間のオンデマンドICデザイン・フロー統合ソリューション

E*ECAD Inc.
Richard Siemiatkowski 氏 (社長兼COO)

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時間14:30〜15:15 ■Apache社製 Power Integrity Tool について

(株)キー・ブリッジ
北原 厚 氏 (Application Engineer/Apache Design Solutions, Inc.)

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■コーウェアのシステムレベル設計ツールConvergenSC、およびプロセッサ開発ツールLISATekの紹介

コーウェア(株)
川原 常盛 氏 (フィールド・アプリケーション&マーケティング グループ/マネージャ)

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■「SRAMライブラリ作成システム : "CharFlo-Memory!"(ケアフルメモリ)」

セイコーインスツルメンツ(株)/(株)ジーダット
柿木 利彦 氏

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時間14:30〜15:15 ■LSI、PCB一体検証によるPowerIntegrityおよびEMI対策設計

富士通(株)
登坂 正喜 氏 (テクノロジセンター 回路シミュレーション技術部 課長)

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■InTimeの提案するRTLハンドオフフローとそのテクノロジー

イノテック(株)
George Janac 氏 (CEO/InTime Software, Inc.)

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■スケーラブルなSoC検証環境の構築 -VStationTBX HDLからCベースそしてインサーキットエミュレーションへのスムースな移行-

メンター・グラフィックス・ジャパン(株)
照井 真一 氏 (エミュレータ営業部 技術営業グループ マネージャー)

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時間14:30〜15:15 ■Integrated Design Methodology: The only way to design 300M Gates in 65nm

マグマ・デザイン・オートメーション(株)
Nitin Deo 氏 (Vice President of Product Marketing/Magma Design Automation Inc.)

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時間15:30〜16:15 ■10GビットSERDESソリューション、及び効率良いシステム設計が可能なクロ ック系&電源系デバイスの紹介

ラティスセミコンダクター(株)
Jock Tomlinson 氏 (Vice President of Applications / Lattice Semiconductor Corporation)

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■最新IP製品のご紹介(OTG、UTMI+、PCI-Express)

メンター・グラフィックス・ジャパン(株)
白田 善久 氏 (テクニカルセールス部 IP マネージャー)

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■Synchronicityが提案する効率的なデータ管理、プロジェクト管理ソリューション

伊藤忠テクノサイエンス(株)
渡辺 雄一郎 氏 (EDA技術2グループ)

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時間15:30〜16:15 ■ミリオンゲート対応の高速プロパティチェック&高速スーパーリント *ベリフィケーションテクノロジー(株)様・大規模検証サービスの発表*

ゼロインデザインオートメーション(株)
増田 真吾 氏 (デザインベリフィケーションコンサルタント)

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■PDKを使用したSDL

(株)シルバコ・ジャパン
桑垣 武司 氏 (CADシニア・アプリケーション・エンジニア)

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  時間15:30〜16:15 ■ナノテク時代のSoC検証クライシス打破のカギ"Cedar"上流設計実践のポイント

富士通(株)
鈴木 康弘 氏 (ディジタルエンジニアリングソリューション事業部 担当部長/富士通キャドテック(株))

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■<スキャン診断におけるLSI内部信号計測>(時間分解型顕微鏡を用いた解析の時間短縮)

イノテック(株)
Steven Kasapy 氏 (Director of Technical Marketing/Credence Systems Corporation)

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■Virtuosoカスタム設計プラットフォームのご紹介

日本ケイデンス・デザイン・システムズ社
岸本 毅 氏 (プロダクト・マーケティング マネージャ)

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時間15:30〜16:15 ■The True Story; 10M gate design in 4 weeks

マグマ・デザイン・オートメーション(株)
陳 暁 氏 (シニア アプリケーション エンジニア)

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時間16:30〜17:15 ■RTLからレイアウトまでを網羅したSoCパワー解析/パワー最適化ソリューション

日本シノプシス(株)
落合 恵一 氏 (技術本部  スタッフ アプリケーション コンサルタント)

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■システムレベル検証を加速するアクシス社のDesign Team Emulation

アクシスジャパン(株)
大島 良夫 氏 (COO)

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■次世代RFIC設計システムAnalog Office

NTTアドバンステクノロジ(株)
田所 紀彦 氏 (CADシステム事業部 回路設計技術部)

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時間16:30〜17:15       時間16:30〜17:15   ■DAP/DNAダイナミック・リコンフィギュラブル・プロセッサが作り出す次の潮流

アイピーフレックス(株)
佐藤 友美 氏 (取締役副社長・CTO)

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■Cadence DFM Strategy - toward Manufacturing Closure and Cost reduction

日本ケイデンス・デザイン・システムズ社
Adolph Hunter 氏 (Group Director of Marketing, Design for Manufacturing/米国ケイデンス・デザイン・システムズ社)

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時間16:30〜17:15  


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