Electronic Design and Solution Fair 2006
 
Azuro, Inc. [新興ベンダーパビリオン]
Azuro, Inc. [Venture Company Pavilion]
1001
 
 
本社 100 View Street, Suite 200 Mountain View, CA94041
連絡先 Atsushi Ura, Keybridge, Inc. (for Azuro)
TEL:+81-3-5304-2591
FAX:+81-3-5304-2490
E-mail:ura@keybridge.co.jp
URL:http://www.azuro.com
出展物紹介 Azuro is an exciting new startup that has developed ground breaking technology that delivers significant reductions in digital logic block dynamic power consumption over leading low power industry design flows. Azuro痴 low power clock implementation tool, PowerCentricTM, brings together innovative approaches to clock tree synthesis, clock gate logic synthesis and vectorless dynamic power analysis to deliver a single, unified clock design closure engine for power sensitive chip design teams.
出展者セミナー  
 
Azuro, Inc. [新興ベンダーパビリオン]
1月26日(木) 第6会場 (DM4)  10:30 〜 11:15
最先端アナログ/RF検証
Ravi Subramanian氏 (President and CEO)
アナログ/RF回路検証の誤り、精度不足はシリコンのリスピンと量産の遅れを招く主要な原因の一つです。チップに占めるアナログ/RF回路の割合が増える中、包括的、高速かつ高精度なアナログ/RF検証は非常に重要です。本セミナーでは、Berkeley Design Automationの開発したシリコン精度の解析エンジンについて紹介します。同社の最初の製品PLL Noise Analyzerは同社独自のStochastic Nonlinear Engine?技術を使用したもので、業界で唯一、PLL全体等の回路の非線形、時変な動作の雑音解析をトランジスタレベルで迅速かつ高精度に行うことができるツールです。




 



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